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[发明专利]组合加载指令或存储指令-CN201980055599.X在审
发明人： H·塔克尔;T·P·施派尔;R·W·史密斯;K·雅格特;J·N·迪芬德尔费尔;M·莫罗;P·戈沙尔;Y·C·特克蒙;B·斯坦普尔;李相勋;M·加格 -专利权人：高通股份有限公司
申请日： 2019-06-17 - 公布日： 2021-04-09 - 主分类号： G06F9/30 文献下载
摘要：本文中公开的各个方面涉及在处理计算机处理器中的指令时，组合用以从存储器加载数据或将数据存储在存储器中的指令。更具体地，参考共同基址寄存器并且未充分利用可用总线宽度的多个存储器访问指令的至少一个模式可以在处理器流水线中被标识。响应于确定多个存储器访问指令将相邻存储器或能够适合在单个缓存行上的非邻接存储器作为目标，多个存储器访问指令可以在处理器流水线内被替换为一个等效存储器访问指令，该等效存储器访问指令比被替换的存储器访问指令中的任何存储器访问指令利用更大的可用总线宽度
组合加载指令存储

[发明专利]指令存储方法-CN201711071313.6有效
发明人：杨磊;刘子君;王东琳 -专利权人：北京思朗科技有限责任公司
申请日： 2017-11-03 - 公布日： 2020-08-11 - 主分类号： G06F9/30 文献下载
摘要：本发明公开了一种指令存储方法。其中，所述方法包括：获取原有指令段；将所述原有指令段中的空指令替换为WAIT指令，和/或，将所述原有指令段中的预设重复单元替换为LOOP循环体，以实现对指令段的纵向压缩；和/或，为所述原有指令段设置说明段，根据所述说明段对所述原有指令段中的空指令进行剔除，并在说明段中作出相应标记，以实现对指令段的横向压缩；将压缩后的指令段进行存储。采用本方案，可减少指令段中的冗余信息，降低指令纵向和/或横向长度，从而进一步减少指令段存储所需的存储空间，降低存储成本。
指令存储方法

[发明专利]加载区块指令和存储区块指令-CN202180090680.9在审
发明人：阿拉斯代尔·格兰特;斯图尔特·罗伯特·道格拉斯·蒙蒂斯 -专利权人： ARM有限公司
申请日： 2021-12-09 - 公布日： 2023-09-08 - 主分类号： G06F9/30 文献下载
摘要：处理电路(16)和指令解码器(9)支持加载区块指令和存储区块指令，该加载区块指令和该存储区块指令可用于实现存储器拷贝函数和用于操纵或比较存储器块的其他库函数。响应于这些指令而加载或存储的字节数量是基于特定于具体实施的条件来确定的。除了加载或存储多个字节的数据之外，该加载区块指令和(10)该存储区块指令还将加载/存储长度值指定为与架构上可见的寄存器对应的数据，该加载/存储长度值提供所加载或所存储的字节数量的指示。
加载区块指令存储

[发明专利]计算机系统内部处理指令的装置-CN02140762.2无效
发明人：钱达·S·乔希;保罗·罗德曼;彼得·苏颜特;莫尼卡·R·诺法尔 -专利权人：硅图像有限公司;株式会社东芝
申请日： 1994-12-15 - 公布日： 2004-04-28 - 主分类号： G06F9/38 文献下载
摘要：计算机系统具有第1及第2指令存储电路，各指令存储电路存储用于并行输出的N个指令。与第1指令存储电路连接的指令调度电路调度存储在第1指令存储电路内的L个指令，这里，L等于或小于N。与第1及第2指令存储电路连接的指令装入电路在L个指令从第1指令存储电路内调度出之后并且别的指令还未从第1指令存储电路调度之前将L个指令从第2指令存储电路装入第1指令存储电路。
计算机系统内部处理指令装置

[发明专利]计算机系统内部处理指令的装置-CN94191180.2无效
发明人：钱达·Ｓ·乔希;保罗·罗德曼;彼得·苏颜特;莫尼卡·Ｒ·诺法尔 -专利权人： MIPS技术公司;东芝株式会社
申请日： 1994-12-15 - 公布日： 2003-04-02 - 主分类号： G06F9/38 文献下载
摘要：计算机系统具有第1及第2指令存储电路，各指令存储电路存储用于并行输出的N个指令。与第1指令存储电路连接的指令调度电路调度存储在第1指令存储电路内的L个指令，这里，L等于或小于N。与第1及第2指令存储电路连接的指令装入电路在L个指令从第1指令存储电路内调度出之后并且别的指令还未从第1指令存储电路调度之前将L个指令从第2指令存储电路装入第1指令存储电路。
计算机系统内部处理指令装置

[发明专利]指令存储器电路-CN99100326.8无效
发明人：行木浩 -专利权人：恩益禧电子股份有限公司
申请日： 1999-01-21 - 公布日： 2003-12-24 - 主分类号： G06F12/06 文献下载
摘要：指令存储器电路包括外部指令存储器，用于存放多个指令码；内部指令存储器，为存储指令码其具有将存入其中的预先从外部指令存储器读出的指令码快速输出和改写的能力，并输出指令码以执行指令，内部指令存储器包括第1至第N个能被独立访问的存储单元。指令存储器电路还包括存储单元读装置和存储单元写装置，根据本发明，“从存储单元读(执行)指令码”能与“指令码写入另一个存储单元”同步执行，从而可实现高速高效的指令执行操作。
指令存储器电路

[发明专利]处理器用指令存储系统-CN201310722652.1有效
发明人：郑茳;肖佐楠;匡启和;竺际隆;张艳丽;李利 -专利权人：苏州国芯科技有限公司
申请日： 2013-12-24 - 公布日： 2017-03-22 - 主分类号： G06F12/02 文献下载
摘要：本发明提供一种处理器用指令存储系统，包括CPU处理单元、指令存储器和高速缓存单元；所述高速缓存单元包括地址路径模块、数据路径模块、控制逻辑模块和指令存储模块；所述指令存储模块存储若干个指令段，该指令段由指令地址位、指令状态位和指令数据位组成，指令数据位用于存储来自指令存储器的指令信息，所述指令地址位用于存储指令数据位中指令信息在指令存储器中对应的指令地址信息，指令状态位用于标识所述指令段中指令信息是否有效；所述指令存储模块包括指令数据寄存器、指令地址寄存器、状态寄存器。本发明方便了cache的flush操作，且在CPU对指令存储器执行编程操作后，可以支持仅清除掉缓存中该编程地址对应的指令段，大大缩短了原有技术在遇到CPU对指令存储器执行编程操作时需要清除缓存的时间。
处理器用指令存储系统

[发明专利]指令处理方法、指令处理装置及存储介质-CN202111245568.6有效
发明人：金伟松 -专利权人：海光信息技术股份有限公司
申请日： 2021-10-26 - 公布日： 2022-05-06 - 主分类号： G06F9/38 文献下载
摘要：一种指令处理方法、指令处理装置及存储介质。该指令处理方法包括：将接收的对象指令同时分发至多个指令缓存单元中缓存，其中，多个指令缓存单元中的每个分别与不同的至少一个能够执行对象指令的执行单元对应连接，响应于多个指令缓存单元中第一数量的第一指令缓存单元中缓存的对象指令首先满足被执行条件，在与第一指令缓存单元对应连接的执行单元中选择第一执行单元执行对象指令，第一数量为一个或多个。该指令处理方法能够将选定类型的对象指令的执行时间提前，从而提高处理器性能。
指令处理方法装置存储介质

[发明专利]指令发送方法、芯片和电子设备-CN202110044577.2有效
发明人：胡云鹏;王洪;曾纪国 -专利权人：成都国科微电子有限公司
申请日： 2021-01-13 - 公布日： 2022-11-15 - 主分类号： G06F9/30 文献下载
摘要：本发明涉及通信领域，提供一种指令发送方法、芯片和电子设备。通过当得到待存储指令时，判断待存储指令与第一目标存储单元中的第N个已存储指令是否连续，N是第一目标存储单元当前存储的指令总数，若连续，则将待存储指令作为第N+1个已存储指令，存储到第一目标存储单元中，当第一目标存储单元中的全部已存储指令的指令长度值，等于预设指令长度值时，发送全部已存储指令，从而实现一次发送多个指令，提高了数据传输的效率。
指令发送方法芯片电子设备

[发明专利]电能计量信号处理器的指令译码屏蔽系统与方法-CN201310372604.4有效
发明人：孔泉 -专利权人：万高（杭州）科技有限公司
申请日： 2013-08-23 - 公布日： 2013-12-11 - 主分类号： G06F9/30 文献下载
摘要：一种电能计量信号处理器的指令译码屏蔽系统，包括指令存储器、数字信号处理器、数据存储器及译码逻辑单元。其中指令存储器存储有该电能计量信号处理器的所有控制指令，数字信号处理器从该指令存储器读取指令，而数据存储器则存储有运算相关的数据，译码逻辑单元接收数字信号处理器将从指令存储器中读到的指令并进行译码，其中该指令存储器中存储有屏蔽指令译码的指令，数字信号处理器读取该屏蔽指令译码的指令并对该指令进行解析，判断是否需要对后续的指令进行屏蔽，如果需要屏蔽，数字信号处理器将空操作指令送入译码逻辑单元，反之数字信号处理器将从指令存储器中读到的指令送入译码逻辑单元
电能计量信号处理器指令译码屏蔽系统方法

[发明专利]通信处理-CN201780026315.5在审
发明人：约瑟夫·希非 -专利权人：维森楚私人有限公司
申请日： 2017-04-20 - 公布日： 2018-12-21 - 主分类号： G16H40/60 文献下载
摘要：公开了一种用于处理在控制主单元与包括从设备存储器的从设备之间无线发送的指令的系统和方法。控制主单元向从设备发送指令。从设备将接收到的指令写入到从设备存储器；从该存储器中读取与写入到该存储器的指令相对应的存储指令；并向控制主单元发送存储指令。控制主单元将存储指令与该指令进行比较，以及如果该存储指令与该指令相同，则使得处理指令能够被发送到从设备。响应于接收到处理指令，从设备对存储指令进行处理。
从设备存储指令存储器主单元指令处理指令写入读取发送指令通信处理无线发送发送响应

[发明专利]用于嵌入式系统的指令存储装置-CN201310722461.5有效
发明人：郑茳;肖佐楠;匡启和;竺际隆;张艳丽;李利 -专利权人：苏州国芯科技有限公司
申请日： 2013-12-24 - 公布日： 2017-06-20 - 主分类号： G06F12/0893 文献下载
摘要：本发明提供一种用于嵌入式系统的指令存储装置，包括CPU处理单元、用于存储指令信息的指令存储器和存放有若干个指令段的高速缓存单元；所述高速缓存单元包括地址路径模块、数据路径模块、控制逻辑模块、随机存储器和状态寄存器；所述指令段由指令地址位、指令状态位和指令信息位组成；随机存储器包括指令信息存储区、指令地址存储区，所述指令信息存储区用于集中存放所述若干个指令段中各自的指令信息，所述指令地址存储区用于集中存放所述若干个指令段中各自的指令地址信息本发明可以方便的清除指令段，且在CPU对指令存储器执行编程操作后，可以支持仅清除掉高速缓存器中该编程地址对应的指令段，大大缩短了原有技术在遇到CPU对指令存储器执行编程操作时需要flush cache的时间
用于嵌入式系统指令存储装置

[发明专利]存储载入单元投机执行控制装置-CN201210157282.7有效
发明人：严晓浪;仇径;葛海通;孟建熠 -专利权人：杭州中天微系统有限公司
申请日： 2012-05-17 - 公布日： 2012-10-10 - 主分类号： G06F3/06 文献下载
摘要：一种存储载入单元投机执行控制装置，包括：存储/载入指令投机发射序列单元，用于以程序顺序接收存储/载入指令流，并创建保存指令顺序的程序序列矩阵；完成存储/载入指令的数据相关性消除工作，投机地将数据相关性已经消除但地址相关性无法判断的存储/载入指令发射到存储/载入指令执行单元中，并且将未消除数据相关性的存储/载入指令存入指令缓存器中；存储/载入指令执行单元，用于接收来自投机发射序列发射的存储/载入指令，按照指令的类型完成相应的操作；存储/载入指令重排序缓冲器，用于对存储/载入指令的执行进行监控。本发明在处理深流水线处理时加速存储载入操作、保证正确性、提升存储器性能。
存储载入单元投机执行控制装置

[发明专利]扩展指令字折叠设备-CN01122079.1有效
发明人：赵璟衍;林钟润;李根泽;吴亨哲;金贤奎;闵炳權;李熙 -专利权人：先进数字芯片股份有限公司
申请日： 2001-05-30 - 公布日： 2002-02-13 - 主分类号： G06F12/04 文献下载
摘要：一种扩展指令字折叠设备,包括指令字存储单元,用于存储包括多个通用指令和扩展指令字的指令字,具有多个缓冲器的暂时存储单元,用于存储多个指令字,指令字搜索单元,用于接收暂时存储单元的多个指令字,解码接收的指令字,以及输出指令字中表示通用指令字位置和连续扩展指令字位置的位置信号,指令字选择器,用于在存储指令字中选择存储通用指令字的缓冲器,并按照位置信号顺序地输出通用指令字,通用指令字分析器,用于接收通用指令字并输出用于执行该通用指令字的多个控制信号,扩展数据分析器,按照从指令字搜索单元输出的位置信号,执行存储在每个缓冲器的指令字的连续扩展指令字的操作数的运算处理,并输出扩展数据,和扩展数据存储单元,用于存储从扩展数据分析器接收的扩展数据。
扩展指令折叠设备

[发明专利]一种超标量微处理器存储指令不等数据提前提交方法-CN202211480671.3在审
发明人：尹飞;路冬冬;范好好;颜世云;何军;冯烁;蒋生健 -专利权人：上海高性能集成电路设计中心
申请日： 2022-11-23 - 公布日： 2023-03-03 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及一种超标量微处理器存储指令不等数据提前提交方法，包括：从指令序列中获取访存指令，所述访存指令包括装入指令和存储指令；将所述存储指令分解为地址计算微指令和存储数据微指令，所述地址计算微指令和存储数据微指令一起进入发射队列，并独自进行发射和执行；所述地址计算微指令被优先发射，执行访存地址计算、虚实地址代换和对存储子系统访问；若所述地址计算微指令命中一级数据Cache并获得可写权限、且所述存储指令已成为指令序列中最年老的指令，则无论所述存储数据微指令是否已发射和执行，则提交所述存储指令。
一种标量微处理器存储指令不等数据提前提交方法

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